Designfehlerbehebung NetIO-Board - Versionsgeschichte

Freesol am 22. März 2014 um 06:31 Uhr

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	Das gilt somit auch für folgende Pin´s Bezeichnung :		Das gilt somit auch für folgende Pin´s Bezeichnung :

	2 VSS -> 28 VDD		* 2 VSS -> 28 VDD
			* 11 VSSRX -> 19 VDDRX
	11 VSSRX -> 19 VDDRX		* 21 VSSPLL-> 20 VDDPLL
			* 22 VSSOSC-> 25 VDDOSC
	21 VSSPLL-> 20 VDDPLL		* 18 VSSTX -> 15 VDDTX

	22 VSSOSC-> 25 VDDOSC

	18 VSSTX -> 15 VDDTX

	siehe Seite 9 Bild Figure 2-4 die im Pollin Schaltplan als C6/C10 bezeichneten Kerko´s.		siehe Seite 9 Bild Figure 2-4 die im Pollin Schaltplan als C6/C10 bezeichneten Kerko´s.

Freesol am 22. März 2014 um 06:30 Uhr

2014-03-22T06:30:54Z

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	All power supply pins must be externally connected to the same power source. Similarly, all ground references		All power supply pins must be externally connected to the same power source. Similarly, all ground references
	must be externally connected to the same ground node. Each VDD and VSS pin pair should have a 0.1 μF ceramic bypass capacitor		must be externally connected to the same ground node. Each VDD and VSS pin pair should have a 0.1 μF ceramic bypass capacitor
	(not shown in the schematic) placed as close to the pins as possible."		(not shown in the schematic) placed as close to the pins as possible.

Freesol am 22. März 2014 um 06:30 Uhr

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	All power supply pins must be externally connected to the same power source. Similarly, all ground references		All power supply pins must be externally connected to the same power source. Similarly, all ground references
	must be externally connected to the same ground node. Each VDD and VSS pin pair should have a 0.1 μF ceramic bypass capacitor (not shown in the schematic) placed as close to the pins as possible."		must be externally connected to the same ground node. Each VDD and VSS pin pair should have a 0.1 μF ceramic bypass capacitor
			(not shown in the schematic) placed as close to the pins as possible."

Freesol am 22. März 2014 um 06:30 Uhr

2014-03-22T06:30:04Z

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	** Im rechten Textblock oberhalb steht folgendes Zitat:		** Im rechten Textblock oberhalb steht folgendes Zitat:

	~~<pre>~~ All power supply pins must be externally connected to the same power source. Similarly, all ground references		All power supply pins must be externally connected to the same power source. Similarly, all ground references
	must be externally connected to the same ground node. Each VDD and VSS pin pair should have a 0.1 μF ceramic bypass capacitor (not shown in the schematic) placed as close to the pins as possible."		must be externally connected to the same ground node. Each VDD and VSS pin pair should have a 0.1 μF ceramic bypass capacitor (not shown in the schematic) placed as close to the pins as possible."
	~~</pre>~~

	Übersetzt heißt das, dass '''ALLE''' Spannungsversorgungs PIN´s gegen Ihre GND Anschlüsse mit 100nF Kerko´s zu bestücken sind.		Übersetzt heißt das, dass '''ALLE''' Spannungsversorgungs PIN´s gegen Ihre GND Anschlüsse mit 100nF Kerko´s zu bestücken sind.

Freesol am 22. März 2014 um 06:29 Uhr

2014-03-22T06:29:37Z

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	** Im rechten Textblock oberhalb steht folgendes Zitat:		** Im rechten Textblock oberhalb steht folgendes Zitat:

	<~~code~~> All power supply pins must be externally connected to the same power source. Similarly, all ground references		<pre> All power supply pins must be externally connected to the same power source. Similarly, all ground references
	must be externally connected to the same ground node. Each VDD and VSS pin pair should have a 0.1 μF ceramic bypass capacitor (not shown in the schematic) placed as close to the pins as possible."		must be externally connected to the same ground node. Each VDD and VSS pin pair should have a 0.1 μF ceramic bypass capacitor (not shown in the schematic) placed as close to the pins as possible."
	</~~code~~>		</pre>

	Übersetzt heißt das, dass '''ALLE''' Spannungsversorgungs PIN´s gegen Ihre GND Anschlüsse mit 100nF Kerko´s zu bestücken sind.		Übersetzt heißt das, dass '''ALLE''' Spannungsversorgungs PIN´s gegen Ihre GND Anschlüsse mit 100nF Kerko´s zu bestücken sind.

Freesol am 22. März 2014 um 06:29 Uhr

2014-03-22T06:29:21Z

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	** Im rechten Textblock oberhalb steht folgendes Zitat:		** Im rechten Textblock oberhalb steht folgendes Zitat:

	<~~quote~~> All power supply pins must be externally connected to the same power source. Similarly, all ground references		<code> All power supply pins must be externally connected to the same power source. Similarly, all ground references
	must be externally connected to the same ground node. Each VDD and VSS pin pair should have a 0.1 μF ceramic bypass capacitor (not shown in the schematic) placed as close to the pins as possible."		must be externally connected to the same ground node. Each VDD and VSS pin pair should have a 0.1 μF ceramic bypass capacitor (not shown in the schematic) placed as close to the pins as possible."
	</~~quote~~>		</code>

	Übersetzt heißt das, dass '''ALLE''' Spannungsversorgungs PIN´s gegen Ihre GND Anschlüsse mit 100nF Kerko´s zu bestücken sind.		Übersetzt heißt das, dass '''ALLE''' Spannungsversorgungs PIN´s gegen Ihre GND Anschlüsse mit 100nF Kerko´s zu bestücken sind.

Freesol am 22. März 2014 um 06:28 Uhr

2014-03-22T06:28:54Z

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	</quote>		</quote>

	Übersetzt heißt das, ~~das~~ '''ALLE''' Spannungsversorgungs PIN´s gegen Ihre GND Anschlüsse mit 100nF Kerko´s zu bestücken sind.		Übersetzt heißt das, dass '''ALLE''' Spannungsversorgungs PIN´s gegen Ihre GND Anschlüsse mit 100nF Kerko´s zu bestücken sind.
	Auch wenn diese in der Zeichnung unterhalb fehlen. Ist gemein, ich weiß.		Auch wenn diese in der Zeichnung unterhalb fehlen. Ist gemein, ich weiß.
	Das gilt somit auch für folgende Pin´s Bezeichnung :		Das gilt somit auch für folgende Pin´s Bezeichnung :

Freesol am 22. März 2014 um 06:28 Uhr

2014-03-22T06:28:30Z

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	</gallery>		</gallery>

	Das wars schon mal mit den zwingenden Updates wegen der Bootschleife. Nun sollte es bereits gehen, weitere Berichtigungen sind eher vorsorglich gleich mit zu erledigen.		Das wars schon mal mit den zwingenden Updates wegen der Bootschleife. Nun sollte es bereits gehen, weitere Berichtigungen sind eher vorsorglich gleich mit zu erledigen:

	*C6 & C10 hinter IC3=ENC28J60 sollten 100nF anstelle von 10nF sein.		*C6 & C10 hinter IC3=ENC28J60 sollten 100nF anstelle von 10nF sein.

Freesol am 22. März 2014 um 06:28 Uhr

2014-03-22T06:28:19Z

← Nächstältere Version		Version vom 22. März 2014, 08:28 Uhr
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	Datei:AVR_NET-IO_Cs.jpg\|Lötseite einer Platine, bei der Designfehler beseitigt sind.		Datei:AVR_NET-IO_Cs.jpg\|Lötseite einer Platine, bei der Designfehler beseitigt sind.
	</gallery>		</gallery>
	~~AVR_NET-IO_Cs.jpg~~

	Das wars schon mal mit den zwingenden Updates wegen der Bootschleife.		Das wars schon mal mit den zwingenden Updates wegen der Bootschleife. Nun sollte es bereits gehen, weitere Berichtigungen sind eher vorsorglich gleich mit zu erledigen.


	Nun sollte es bereits gehen, weitere Berichtigungen sind eher vorsorglich gleich mit zu erledigen.

	*C6 & C10 hinter IC3=ENC28J60 sollten 100nF anstelle von 10nF sein.		*C6 & C10 hinter IC3=ENC28J60 sollten 100nF anstelle von 10nF sein.

Freesol am 22. März 2014 um 06:27 Uhr

2014-03-22T06:27:32Z

← Nächstältere Version		Version vom 22. März 2014, 08:27 Uhr
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	'''Behebung von Designfehlern der AVR NET-IO Schaltung'''		'''Behebung von Designfehlern der AVR NET-IO Schaltung'''

	Bei dem Schaltungsdesign des AVR NET IO Boards kommt es zu weilen zu einer Bootschleife.		Bei dem Schaltungsdesign des AVR NET IO Boards kommt es zu weilen zu einer Bootschleife. Die Fehlerursachen sind in mehreren Quellen zu finden, haupsächlich aber ist eine fehlerhafte Siebung unter Nichtbeachtung der Datenbätter Schuld.

	Die ~~Fehlerursachen sind in mehreren Quellen zu finden~~.		Die Angaben (Bauteilbezeichnungen) beziehen sich auf die im AVR NET-IO Schaltplan http://www.pollin.de/shop/downloads/D810058B.PDF].

	~~Haupsächlich sind diese auf fehlerhafte Siebung unter Nichtbeachtung der Datenbätter zu finden.~~		Kurzanleitung für die notwendigen Updates zur Fehlerbeseitigung:
			* Spannungsversorgung 3V ist nach Regler IC2 führt ungesiebt an IC3=ENC28J60. Also Elko 22yF/6,3V zwischen Pin A und GND von IC2 schalten.
	~~Die Angaben (Bauteilbezeichnungen) beziehen sich auf~~ die ~~im AVR NET-IO Schaltplan http~~:~~//www.pollin.de/shop/downloads/D810058B.PDF]~~		* IC3=ENC28J60 zwischen folgenden Pin´s je einen Kerko mit 100nF schalten:
			: 2->28; 19->21; 20->22; 11->15; 25->18
	~~Kurzanleitung zur Behebung zwingender Updates.~~

	Spannungsversorgung 3V ist nach Regler IC2 führt ungesiebt an IC3=ENC28J60.
	Also Elko 22yF/6,3V zwischen Pin A und GND von IC2 schalten.

	IC3=ENC28J60 zwischen folgenden Pin´s je einen Kerko mit 100nF schalten.

	2->28; 19->21; 20->22; 11->15; 25->18

	Hier mal ein Bild, wie ich das auf der Lötseite der Platine gemacht habe.		Hier mal ein Bild, wie ich das auf der Lötseite der Platine gemacht habe.
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	Das wars schon mal mit den zwingenden Updates wegen der Bootschleife.		Das wars schon mal mit den zwingenden Updates wegen der Bootschleife.

	~~----~~

	Nun sollte es bereits gehen, weitere Berichtigungen sind eher vorsorglich gleich mit zu erledigen.		Nun sollte es bereits gehen, weitere Berichtigungen sind eher vorsorglich gleich mit zu erledigen.

	C6 & C10 hinter IC3=ENC28J60 sollten 100nF anstelle von 10nF sein.		*C6 & C10 hinter IC3=ENC28J60 sollten 100nF anstelle von 10nF sein.

			Weitere optionale Umbauten:
			* Stromverbrauch senken durch Austausch von R3 (220Ohm) gegen 680Ohm.
			* Der IC1 sollte eine Kühlung verpasst bekommen, oder besser gegen einen Schaltregler Variante auswechseln.

	~~----~~


	~~Optionale Umbauten:~~
	~~Stromverbrauch senken durch Austausch von R3 (220Ohm) gegen 680Ohm.~~

	~~Der IC1 sollte eine Kühlung verpasst bekommen, oder besser gegen einen Schaltregler Variante auswechseln.~~


	~~----~~

	Quellenangabe:		Quellenangabe:
			* Datenblatt ENC28J60: [http://ww1.microchip.com/downloads/en/DeviceDoc/39662c.pdf]
			** siehe Seite 9 Bild Figure 2-4 im Pollin Schaltplan nicht vorhandenen Kerko´s.
			** Im rechten Textblock oberhalb steht folgendes Zitat:

	~~Datenblatt ENC28J60: [http://ww1.microchip.com/downloads/en/DeviceDoc/39662c.pdf]~~		<quote> All power supply pins must be externally connected to the same power source. Similarly, all ground references
			must be externally connected to the same ground node. Each VDD and VSS pin pair should have a 0.1 μF ceramic bypass capacitor (not shown in the schematic) placed as close to the pins as possible."
	~~siehe Seite 9 Bild Figure 2-4 im Pollin Schaltplan nicht vorhandenen Kerko´s.~~		</quote>

	~~Im rechten Textblock oberhalb steht folgendes Zitat:~~

	"All power supply pins must be externally connected to
	the same power source. Similarly, all ground references
	must be externally connected to the same
	ground node. Each VDD and VSS pin pair should have
	a 0.1 μF ceramic bypass capacitor (not shown in the
	schematic) placed as close to the pins as possible."

	Übersetzt heißt das, das '''ALLE''' Spannungsversorgungs PIN´s gegen Ihre GND Anschlüsse mit 100nF Kerko´s zu bestücken sind.		Übersetzt heißt das, das '''ALLE''' Spannungsversorgungs PIN´s gegen Ihre GND Anschlüsse mit 100nF Kerko´s zu bestücken sind.